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PCB設(shè)計(jì)抗干擾性能的評(píng)估

發(fā)布時(shí)間：2016-06-28 08:18:39 分類(lèi)：行業(yè)新聞

在實(shí)際使用中，所有電子設(shè)備都會(huì)受到電磁場(chǎng)的干擾，如果一個(gè)設(shè)備不能滿(mǎn)足抗干擾要求，也不進(jìn)行屏蔽，那么該設(shè)備的性能就會(huì)受電磁干擾的影響。事實(shí)表明，干擾信號(hào)的頻率可能會(huì)有幾百M(fèi)Hz，這些干擾主要通過(guò)連接的導(dǎo)體進(jìn)行耦合，因此I/O模塊的抗干擾設(shè)計(jì)非常重要。

　　為了增強(qiáng)產(chǎn)品的抗干擾性能，有時(shí)不得不增加濾波等手段，這意味著會(huì)增加產(chǎn)品的成本。從這種角度上看，尋找一種能優(yōu)化所有電路和元器件的解決方案非常重要。

　　通過(guò)適當(dāng)修改上面提到的測(cè)量方法，在產(chǎn)品開(kāi)發(fā)和測(cè)試階段就能夠正確評(píng)估產(chǎn)品的抗干擾性能。改進(jìn)后的方法如下：把PCB放在掃描器板上進(jìn)行頻譜掃描以決定PCB設(shè)計(jì)板的干擾頻率，然后把該頻率正弦波干擾信號(hào)用夾子或者適當(dāng)耦合設(shè)備(如平衡線上用的T-LISN)耦合到I/O線或?qū)w上，采用步距10MHz、頻率范圍能滿(mǎn)足10MHz到150MHz(避免與PCB板的干擾頻率重疊)、功率－20到0dBm(取決于耦合器件和PCB的類(lèi)型)的發(fā)生器，執(zhí)行與所加干擾信號(hào)一致的頻率進(jìn)行空間掃描。

　　干擾信號(hào)從耦合點(diǎn)到PCB內(nèi)的分布情況就能非常清楚地在空間掃描圖形上看出來(lái)，然后可以根據(jù)下面一些原則對(duì)空間掃描結(jié)果進(jìn)行解釋?zhuān)≒CB設(shè)計(jì)上哪些區(qū)域分布有耦合上去的干擾信號(hào)、插入濾波器的有效性(衰減干擾信號(hào))、臨近I/O導(dǎo)體耦合情況以及PCB接地層或者區(qū)域的有效性等

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